以下关于CPU与主存之间增加高速缓存（Cache）的叙述中，错误的是（）。

相似题目

• 在CPU与主存之间设置高速缓冲存储器（Cache），其目的是为了（）

  A . 扩大主存的存储容量 B . 提高CPU对主存的访问效率 C . 既扩大主存容量又提高存取速度 D . 提高外存储器的速度

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• CPU访问高速缓存的时间为（）的1/4-1/10.CPU访问的内容在高速缓冲中为命中，否则为不命中或失靶。命中率=（主存读写时间+高速缓存的读写时间-平均读写时间）/主存读写时间。

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• 以下关于CPU与主存之间增加调整缓存（Cache）的叙述，不正确的是（）。

  A . Cache扩充了主存储器的容量 B . Cache可以降低由于CPU与主存之间的速度差异造成的系统性能影响 C . Cache的有效性是利用了对主存储器访问的局部特征 D . Cache中通常保存着主存储器中部分内容的一份副本

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• 下面是关于CPU访问主存和高速缓存CAChe关系描述，正确的有（）

  A . 没有CAChe的微机，只有主存能与CPU直接进行信息交换 B . 拥有CAChe的微机，CAChe和主存都能直接与CPU交换信息 C . 一台装有CAChe的微机，CPU从外存读人数据的顺序是外存→主存→CAChe D . CAChe使用的是半导体动态存储器，所以其中的信息不能长期保留

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• 解决CPU与主内存之间的速度匹配的主要方法是在CPU与DRAM间加上二级高速缓存[L2Cache]

  A . 正确 B . 错误

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• 高速缓冲存储器（Cache）用于CPU与主存储器之间进行数据交换的缓冲。其特点是速度快，但容量小。

  A . 正确 B . 错误

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• 高速缓存器Cache介于CPU与主存之间，用于解决内存与外存的速度匹配问题，以提高存储速度。

  A . 正确 B . 错误

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• 在主存储器和CPU之间增设高速缓冲存储器Cache的目的是（）。

  A . 扩大主存储器的容量 B . 解决CPU与主存储器之间的速度匹配问题 C . 扩大CPU中通用寄存器的数量 D . 既扩大主存储器的容量又扩大CPU中通用寄存器的数量

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• CPU的运算速度与许多因素有关，下面哪些是提高运算速度的有效措施（） ①增加CPU中寄存器的数目  ②提高CPU的主频  ③增加高速缓存（cache）的容量  ④优化BIOS的设计   （  ）

  A . ①和③ B . ①、②和③ C . ①和④ D . ②、③和④

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• 主存储器和CPU之间增加Cache的目的是（）。

  A . 解决CPU和主存之间的速度匹配问题 B . 扩大主存储器容量 C . 扩大CPU中通用寄存器的数量 D . 既扩大主存储器容量，又扩大CPU中通用寄存器的数量

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• 计算题：假设高速缓存Cache工作速度为主存的5倍，且Cache被访问命中的概率为90%，则采用Cache后，能使整个存储系统获得多高的加速比？

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• Cache（高速缓冲存储器）用于存放主存数据的部分拷贝，主存单元地址与Cache单元地址之间的转换工作由（）完成。

  A . 硬件 B . 软件 C . 用户 D . 程序员

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• 位于CPU与主存之间的高速缓冲存储器Cache用于存放部分主存数据的拷贝，主存地址与Cache地址之间的转换工作由（）完成。

  A . A.硬件 B . B.软件 C . C.用户 D . D.程序员

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• 在主存和CPU之间增加Cache的目的是（）。

  A . 扩大主存的容量 B . 增加CPU中通用寄存器的数量 C . 解决CPU和主存之间的速度匹配 D . 代替CPU中的寄存器工作

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• 与主存相比，Cache（缓存）的存取速度、容量分别为（）。

  A . 快、大 B . 快、小 C . 慢、大 D . 慢、小

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• 高速缓存Cache与主存间采用全相联地址映像方式，高速缓存的容量为4MB，分为 4块，每块IMB，主存容量为256MB。若主存读写时间为30ns，高速缓存的读写时间为3ns，平均读写时间为3.27ns，则该高速缓存的命中率为(13)%。若地址变换表如下所示，则主存地址为8888888H时，高速缓存地址为(14)H。

  <img src='https://img2.soutiyun.com/shangxueba/ask/4317001-4320000/4319883/ct_crmdtsj_crmdtschoosecnz2_01167(20096).jpg' /> A．90 B．95 C．97 D．99

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• 主存储器和CPU之间增加高速缓冲存储器(Cache)的目的是(1)。

  A．解决CPU、主存速度匹配 B．增加CPU通用寄存器数量 C．扩大主存容量 D．扩大主存容量和增加CPU通用寄存器数量

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• 5、在主存储器和CPU之间增设高速缓冲存储器Cache的目的是（）。

  A．扩大主存储器的容量 B．解决CPU与主存储器之间的速度匹配问题 C．扩大CPU中通用寄存器的数量 D．既扩大主存储器的容量又扩大CPU中通用寄存器的数量

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• ◑高速缓存位于CPU与()之间◑A控制器◑BI/O设备◑C外存◑D主存

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• 高速缓存Cache与主存间采用全相联地址映像方式，高速缓存的容量为4MB，分为 4块，每块1MB，主存容量为256MB。若主存读写时间为30ns，高速缓存的读写时间为 3ns，平均读写时间为3.27ns，则该高速缓存的命中率为(1)%。若地址变换表如下所示，则主存地址为8888888H时，高速缓存地址为(2)H。<img src='https://img2.soutiyun.com/shangxueba/ask/1515001-1518000/1517874/ct_crmntsz_crmntschoosecnz2_00301(20094).jpg' />

  A．90 B．95 C．97 D．99

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• 以下关于CPU缓存（Cache）的说法不正确的是（）

  A．CPU缓存的作用是存储一些常用的或即将用到的数据或指令 B．CPU缓存的读写速度比内存快 C．CPU缓存的容量比内存大、价格比内存高 D．CPU缓存能提高CPU对指令的处理速度

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• CPU与主存之间的cache是为了解决期间问题。;（）

  A．距离; B．总线约束; C．速度匹配; D．容量扩充;

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• 3、CPU Cache利用（），将频繁访问的数据存储在高速缓存中，使数据的访问速度与处理器速度匹配。

  A．时间重叠 B．摩尔定律 C．资源共享 D．局部性原理

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• 32、主存和CPU之间增加高速缓冲存储器的目的是（）

  A．解决CPU和主存之间的速度不匹配问题 B．扩大主存容量 C．既扩大主存容量，又提高存取速度 D．仅为提高存取速度

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