CPU发出的访问存储器的地址不是（）
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CPU能直接访问的存储器有（）.
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CPU要访问的某一存储单元的实际地址称（）
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CPU能够直接访问的存储器是（）。
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CPU不能直接访问的存储器是（）。
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80486CPU的虚拟存储器管理技术中，CPU内的分段机制将（）地址变换为线性地址，CPU内的分页机制将线性地址变换为在（）地址总线上传送的地址.
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在DRAM中，由于存储地址空间时按（）排列的，所以当访问某和页面时，切换到另一页面会占用CPU额外的时钟周期。
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CPU能直接访问的存储器是（）。
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8086CPU访问存储器，当地址A0=0时（）。
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地址总线宽度决定CPU可以访问的物理地址空间。
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8086CPU使用（）根地址线访问I/O端口，最多可访问（）个字节端口，使用（）根地址线访问存储单元，最多可访问（）个字节单元。
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CPU能直接访问的存储器是（）
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CPU可以直接访问的存储器是（）。
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ALE是地址锁存允许信号端。当80C51上电正常工作后，ALE引脚不断向外输出正脉冲信号，此频率为振荡器频率的（）。CPU访问片外存储器时，会丢失一个脉冲。
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存储器越靠近CPU，则CPU对它的访问频度越（），这是通过（）原理来完成的。
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CPU不能直接访问的存储器是（）
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80386以后CPU的内存地址访问模式有（）。
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CPU可以直接访问的存储器是（ ）。
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8086 CPU使用______根地址线访问I/O端口，最多可访问______个字节端口，使用______根地址线访问存储单元，最多可访问______个字节单元。
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使用Cache是为了解决______问题，存储管理主要由______实现；使用虚拟存储器是为了解决扩大主存容量和地址分配问题，存储管理主要由______实现。后一种情况下，CPU______访问第二级存储器。
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基本总线周期划分为T1、T2、T3和T4四个状态的CPU，当它执行一个正常的存储器读总线周期时，系统规定：读命令在T2开始时产生，T4开始时结束，则访问存储器地址信号的发生应在()状态。
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CPU不能直接访问的存储器是 。
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当访问存储器或外设时，存储器或外设不能及时配合CPU传输数据时，存储器或外设通过“READY”信号在T3之前向CPU发出一个“数据未准备好”信号，CPU会在T3之前插入一个或多个等待时间周期。当存储器或外设准备好数据，通过“READY”发“准备好”信号，CPU接受此信号后，会自动脱离 TW状态进入T4状态。因此，插入多少个TW由“READY”信号决定。
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16、有一主存-cache层次的存储器，主存容量为1MB，cache容量为16KB，每字块有8个字，每字32位。采用直接地址映射方式，若主存地址为35301H，且CPU访问cache命中，则在cache的第_______字块中。（cache的起始字块为第0字块）
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