8086 CPU在（）时刻采样READY信号决定是否插入等待周期。

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• 8086的准备就绪信号READY是（）。

  A . 输入信号，当READY=L（低电平）时，CPU将插入等待周期TW B . 输入信号，当READY=H（高电平）时，CPU将插入等待周期TW C . 输出信号，当READY=H（高电平）时，CPU将插入等待周期TW D . 输出信号，当READY=L（低电平）时，CPU将插入等待周期TW

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• 在8086/8088中，在T1状态，CPU往总线发出（）信号。

  A . 数据 B . 状态 C . 地址 D . 其它

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• 8086/8088 CPU提供了接受外部中断请求信号的引脚是什么？

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• 外部设备向8086/8088CPU申请可屏蔽中断时，中断请求信号是通过其（）引脚进入CPU的。

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• 8086CPU读数据操作在总线周期的（）时刻.

  A . T1 B . T1，T2 C . T2，T3 D . T3，T4

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• 8086CPU的INTR引脚上输入的信号是（）

  A . 可屏蔽中断请求 B . 非屏蔽中断请求 C . 中断相应 D . 总线请求

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• 8086准备好READY引脚输出给存储器或外设有效信号，表明处理器准备好交换数据了。

  A . 正确 B . 错误

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• 以下8086CPU的引脚中属于输入信号的的是：（）

  A .https://assets.asklib.com/images/image2/2017101016234962955.jpg B . HOLDC .https://assets.asklib.com/images/image2/2017101016235333306.jpg D . READY

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• 合并单元采样点应该和外部时钟同步信号进行同步，在同步秒脉冲时刻，采样点的样本计数应（）。

  A . 翻转置0 B . 加1 C . 减1 D . 维持不变

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• Intel8086/8088CPU中，决定是否需要在T3周期后插入TW周期是根据什么来决定的？

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• 8086在存储器读写时，遇到READY无效后可以插入（）

  A . 1个等待周期 B . 2个等待周期 C . 3个等待周期 D . 插入等待周期的个数可不受限制

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• 8086/8088CPU构成系统的两种组态，与之有关的控制信号是（）

  A . S0、S1、S3B .https://assets.asklib.com/images/image2/2017101309082786461.jpg C . TESTD . QS0，QS1

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• 设8086/8088CPU时钟为5MHz，在访问外设时若在插入2个等待状态后，READY才有效，则该总线周期需要的时间为（）。

  A . 0.8s B . 5s C . ls D . 1.2

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• 8086CPU用于中断请求输入的引脚信号是（）。

  A . INTR和NMI B . INI和NMI C . INTR和INTA D . INTE和INET

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• 以下对8086CPU的READY引脚的描述中，正确的有：（）

  A . 输入引脚 B . 输出引脚 C . 高电平表示存储器或外设已准备好 D . 低电平表示存储器或外设已准备好

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• 8086CPU的引脚中，接有硬中断信号的引脚有（）。

  A . 15个 B . 8个 C . 2个 D . 1个

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• 以下8086CPU的引脚中属于输出信号的的是：（）

  A .https://assets.asklib.com/images/image2/2017101016243425156.jpg B . HOLDC . DEND . READY

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• 8086CPU在进行写内存操作时，控制信号M/IO－和DT／R－是（）

  A . A、00 B . B、01 C . C、10 D . D、11

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• 8086CPU用于中断请求输入的引脚信号是（）

  A．INTR和NMI B．INI和NMI C．INTR和INTA D．INTE和INET

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• 8086CPU的NMI引脚上输入的信号是。

  A．可屏蔽中断请求 B．非屏蔽中断请求 C．中断响应 D．总线请求

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• 当访问存储器或外设时，存储器或外设不能及时配合CPU传输数据时，存储器或外设通过“READY”信号在T3之前向CPU发出一个“数据未准备好”信号，CPU会在T3之前插入一个或多个等待时间周期。当存储器或外设准备好数据，通过“READY”发“准备好”信号，CPU接受此信号后，会自动脱离 TW状态进入T4状态。因此，插入多少个TW由“READY”信号决定。

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