1、1、连续两次CPU对存储器读/写操作之间的最小间隔称为（）。

相似题目

• CPU对存储器或I/O端口完成一次读/写操作所需的时间称为一个（）

  A . 指令周期 B . 总线周期 C . 时钟周期 D . 传输周期

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• 可进行读、写操作，但断电以后所存储的信息将全部丢失的主存储器称为（）。

  A . 随机访问存储器 B . ROM C . RAM D . 只读存储器

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• 假设每个磁盘存储块中可以存放某文件的10个记录，记录的编号从0开始，主存中用于记录的成组和分解的缓冲区的大小与磁盘存储块的大小相等。如果有个使用该文件的用户程序在自己的内存空间中分别设置了“读记录工作区”和“写记录工作区”，每个工作区的大小均相当于一个记录的大小。若依次进行写记录11、读记录15、写记录1、读记录3、写记录17五步操作，如果在操作前主存缓冲区是空的，那么要完成这些操作需要启动磁盘读或写的次数是（）

  A . 5次 B . 6次 C . 7次 D . 8次

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• 直接存储器访问（DMA）是一种快速传递大量数据常用的技术。工作过程大致如下。 ①向CPU申请DMA传送。 ②获CPU允许后，DMA控制器接管（1）的控制权。 ③在DMA控制器的控制下，在存储器和（2）之间直接进行数据传送，在传送过程中不需要（3）的参与。开始时需提供要传送的数据的（4）和（5）。 ④传送结束后，向CPU返回DMA操作完成信号。空白（4）处应选择（）

  A . A.结束地址 B . 起始地址 C . 设备类型 D . 数据速率

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• 直接存储器访问（DMA）是一种快速传递大量数据常用的技术。工作过程大致如下。 ①向CPU申请DMA传送。 ②获CPU允许后，DMA控制器接管（1）的控制权。 ③在DMA控制器的控制下，在存储器和（2）之间直接进行数据传送，在传送过程中不需要（3）的参与。开始时需提供要传送的数据的（4）和（5）。 ④传送结束后，向CPU返回DMA操作完成信号。空白（1）处应选择（）

  A . A.系统控制台 B . 系统总线 C . I/O控制器 D . 中央处理器

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• 直接存储器访问（DMA）是一种快速传递大量数据常用的技术。工作过程大致如下。 ①向CPU申请DMA传送。 ②获CPU允许后，DMA控制器接管（1）的控制权。 ③在DMA控制器的控制下，在存储器和（2）之间直接进行数据传送，在传送过程中不需要（3）的参与。开始时需提供要传送的数据的（4）和（5）。 ④传送结束后，向CPU返回DMA操作完成信号。空白（3）处应选择（）

  A . A.外部设备 B . 系统时钟 C . 系统总线 D . 中央处理器

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• 直接存储器访问（DMA）是一种快速传递大量数据常用的技术。工作过程大致如下。 ①向CPU申请DMA传送。 ②获CPU允许后，DMA控制器接管（1）的控制权。 ③在DMA控制器的控制下，在存储器和（2）之间直接进行数据传送，在传送过程中不需要（3）的参与。开始时需提供要传送的数据的（4）和（5）。 ④传送结束后，向CPU返回DMA操作完成信号。空白（2）处应选择（）

  A . A.外部设备 B . 运算器 C . 缓存 D . 中央处理器

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• 8088CPU在最小模式下对I/O进行读操作时，有效控制信号为（）。

  A .https://assets.asklib.com/images/image2/2017101017190212134.jpg 低电平，https://assets.asklib.com/images/image2/2017101017184880554.jpg 三态，https://assets.asklib.com/images/image2/2017101017201530039.jpg 低电平B .https://assets.asklib.com/images/image2/2017101017190212134.jpg 三态，https://assets.asklib.com/images/image2/2017101017184880554.jpg 低电平，https://assets.asklib.com/images/image2/2017101017201530039.jpg 高电平C .https://assets.asklib.com/images/image2/2017101017190212134.jpg 低电平，https://assets.asklib.com/images/image2/2017101017184880554.jpg 三态，https://assets.asklib.com/images/image2/2017101017201530039.jpg 高电平D .https://assets.asklib.com/images/image2/2017101017190212134.jpg 三态，https://assets.asklib.com/images/image2/2017101017184880554.jpg 低电平，https://assets.asklib.com/images/image2/2017101017201530039.jpg 低电平

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• 如用户user1对文件1有“读”权限，user1所属的组group1对文件1有“写”权限，最终user1对该文件可以作什么操作？（）

  A . A.“读” B . B.“写” C . C.“读”和“写” D . D.拒绝访问

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• 直接存储器访问（DMA）是一种快速传递大量数据常用的技术。工作过程大致如下。 ①向CPU申请DMA传送。 ②获CPU允许后，DMA控制器接管（1）的控制权。 ③在DMA控制器的控制下，在存储器和（2）之间直接进行数据传送，在传送过程中不需要（3）的参与。开始时需提供要传送的数据的（4）和（5）。 ④传送结束后，向CPU返回DMA操作完成信号。空白（5）处应选择（）

  A . A.结束地址 B . 设备类型 C . 数据长度 D . 数据速率

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• 在I／O接口电路中，按主机与外设间传送的信息类型，端口可分为哪几类？CPU对这些端口实行读操作还是写操作？

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• 两次CPU对存储器读/写操作之间的最小间隔称为（ ）。

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• Pentium微处理器的突发式存储器读/写总线周期包含几个CPU时钟周期？

  A．2个 B．3个 C．4个 D．5个

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• 主存储器和CPU之间增加高速缓冲存储器(Cache)的目的是(1)。

  A．解决CPU、主存速度匹配 B．增加CPU通用寄存器数量 C．扩大主存容量 D．扩大主存容量和增加CPU通用寄存器数量

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• 当8086CPU进行存储器写操作时应满足的引脚关系为（)。（表示低电平)

  A．M/IO=0,WR=0 B．M/IO=0,WR=1 C．M/IO=1,WR=0 D．M/IO=1,WR=1

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• 微型机读/写控制信号的作用是（)。A．决定数据总线上的数据流方向B．控制存储器操作（读/写)的类型

  微型机读/写控制信号的作用是()。 A．决定数据总线上的数据流方向 B．控制存储器操作(读/写)的类型 C．控制流入、流出存储器信息的方向 D．以上的任一种作用

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• 当M/IO=0，RD=0，WR=1时，CPU完成的操作是（)。A．存储器读B．I/O读C．存储器写D．I/O写

  当M/IO=0，RD=0，WR=1时，CPU完成的操作是()。 A．存储器读 B．I/O读 C．存储器写 D．I/O写

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• 微型机读/写控制信号的作用是（)。A．决定数据总线上的数据流方向B．控制存储器操作（读/写)的类型C．

  微型机读/写控制信号的作用是()。 A．决定数据总线上的数据流方向 B．控制存储器操作(读/写)的类型 C．控制流入、流出存储器信息的方向 D．以上的任一种作用

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• Pentium微理器进行存储器读操作时，在时钟周期了1期间，完成下列操作（)。A．W/R信号变为高电平B．

  Pentium微理器进行存储器读操作时，在时钟周期了1期间，完成下列操作()。 A．W/R信号变为高电平 B．发送存储器地址 C．读操作码 D．读操作数

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• （）是存储器连续二次独立的"读"或"写"操作所需的最短时间。对数据库管理系统评价的主要性能指标有（4）、数据库所允许的索引数量等（）

  A．时钟频率 B．字长 C．可移植性 D．存取周期

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• 有一个16K×16位的存储器，由1K×4位的DRAM芯片构成（芯片是64×64结构)。问：（1)共需要多少RAM芯片？（2)采用异步刷新方式，如单元刷新间隔不超过2ms，则刷新信号周期是多少（3)如采用集中刷新方式，存储器刷新一遍最少用多少读／写周期？死时间率是多少？

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• 8、假定CPU通过存储器总线读取数据的过程为：发送地址和读命令需1个时钟周期，存储器准备一个数据需8个时钟周期，总线上每传送1个数据需1个时钟周期。若主存和cache之间交换的主存块大小为64B，存取宽度和总线宽度都为4B，则cache的一次缺失损失至少为多少个时钟周期？

  A．64 B．72 C．80 D．160

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• 28、总线周期是指CPU对存储器或I/O端口完成读或写操作所需时间

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• （请作答此空）是存储器连续二次独立的"读"或"写"操作所需的最短时间。对数据库管理系统评价的主要性能指标有（4）、数据库所允许的索引数量等。

  A．时钟频率 B． 字长 C． 可移植性 D． 存取周期

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