基本DLX流水线中，load/store指令在EX段的处理动作可表示为：EX/MEM.ALUOutput←（）+（）；
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现采用4级流水线结构分别完成一条指令的取指、指令译码和取数、运算以及送回运算结果4个基本操作，每步操作时间依次为60ns、100ns、50ns和 70ns。该流水线的操作周期应为(1)ns。若有一小段程序需要用20条基本指令完成(这些指令完全适合于流水线上执行)，则得到的第一条指令 结果需(2)ns，完成该段程序需(3)ns。在流水线结构的计算机中，频繁执行(4)指令时会严重影响机器的效率。当有中断请 求发生时，采用不精确断点法，则将(5)。空白（2）处应选择（）
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DLX流水线分为哪几个功能段？
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MIPSR4000整型流水线共有（）段，和DLX流水线不同，R4000特别考虑了流水访问（）的操作。
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现采用4级流水线结构分别完成一条指令的取指、指令译码和取数、运算以及送回运算结果4个基本操作，每步操作时间依次为60ns、100ns、50ns和 70ns。该流水线的操作周期应为(1)ns。若有一小段程序需要用20条基本指令完成(这些指令完全适合于流水线上执行)，则得到的第一条指令 结果需(2)ns，完成该段程序需(3)ns。在流水线结构的计算机中，频繁执行(4)指令时会严重影响机器的效率。当有中断请 求发生时，采用不精确断点法，则将(5)。空白（3）处应选择（）
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现采用4级流水线结构分别完成一条指令的取指、指令译码和取数、运算以及送回运算结果4个基本操作，每步操作时间依次为60ns、100ns、50ns和 70ns。该流水线的操作周期应为(1)ns。若有一小段程序需要用20条基本指令完成(这些指令完全适合于流水线上执行)，则得到的第一条指令 结果需(2)ns，完成该段程序需(3)ns。在流水线结构的计算机中，频繁执行(4)指令时会严重影响机器的效率。当有中断请 求发生时，采用不精确断点法，则将(5)。空白（4）处应选择（）
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基本DLX流水线中，store指令在MEM段的处理动作可表示为：或Mem[（）]←（）；
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基本DLX流水线中，IF段操作可表示为：IF/ID.IR←（）；IF/ID.NPC，PC←（ifEX/MEM.cond{（）}else{}）；
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指令流水线右取指（IF） 、译码（ID）、执行 （EX） 、访存（MEM）、写回寄存器堆（WB）五个过程段，共有20条指令连续输入此流水线。 （1）画出流水处理的时空图，假设时钟周期为100ns。 （2）求流水线的实际吞吐率（单位时间里执行完毕的指令数）。
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在基本DLX流水线基础上，避免控制相关的方法有哪些？
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基本DLX流水线中四个多路选择器的控制端由哪些信息决定？
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Load/Store型机器体系结构设计一定要遵循指令集结构的规整性要求。
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基本DLX流水线中，IF与Mem两个阶段都要访问存储器，怎样避免访存冲突？
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现采用4级流水线结构分别完成一条指令的取指、指令译码和取数、运算以及送回运算结果4个基本操作，每步操作时间依次为60ns、100ns、50ns和 70ns。该流水线的操作周期应为(1)ns。若有一小段程序需要用20条基本指令完成(这些指令完全适合于流水线上执行)，则得到的第一条指令 结果需(2)ns，完成该段程序需(3)ns。在流水线结构的计算机中，频繁执行(4)指令时会严重影响机器的效率。当有中断请 求发生时，采用不精确断点法，则将(5)。空白（1）处应选择（）
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Load/Store型指令集结构
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现采用4级流水线结构分别完成一条指令的取指、指令译码和取数、运算以及送回运算结果4个基本操作，每步操作时间依次为60ns、100ns、50ns和 70ns。该流水线的操作周期应为(1)ns。若有一小段程序需要用20条基本指令完成(这些指令完全适合于流水线上执行)，则得到的第一条指令 结果需(2)ns，完成该段程序需(3)ns。在流水线结构的计算机中，频繁执行(4)指令时会严重影响机器的效率。当有中断请 求发生时，采用不精确断点法，则将(5)。空白（5）处应选择（）
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在DLX基本流水线中可采用哪些静态方法降低分支损失？
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基本DLX流水线中，ALU指令在MEM段的处理动作可表示为：MEM/WB.ALUOutput←（）；
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基本DLX流水线中，假设分支指令需要4个时钟周期，其它指令需要5个时钟周期，分支指令占总指令数的12%，问CPI=（），若把ALU指令的写回提前到MEM段，ALU指令占总指令数的44%，则PI=（）。
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在DLX流水线中，可以在ID段检测所有数据相关。
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在DLX指令实现的简单数据通路中，在WB周期中，有两大类指令执行操作（）和（）指令。
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在基本的DLX流水线数据通路中，一共有四个多路选择器。（)
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基本DLX流水线中，Load指令在MEM段的处理动作可表示为（）←Mem[EX/MEM.ALUOutput]；
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在基本的DLX流水线数据通路中，一共有三个多路选择器。（)
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S3C2440的处理器对内存RAM的访问只能通过Load/Store指令来实现。（)