可屏蔽中断就是它的请求是否被CPU响应要受（）的控制。

相似题目

• 微机系统中若用4片8259A构成主、从两级中断控制逻辑，接至CPU的可屏蔽中断请求线INTR上，最多可扩展为（）级外部硬中断。

  A . 32 B . 29 C . 28 D . 24

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• CPU每次能响应（）个中断源的请求。

  A . 1 B . 2 C . 3 D . 4

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• 当CPU响应外部中断1的中断请求后，将自动转向（）

  A . 0003H B . 0013H C . 000BH D . 001BH

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• 8086CPU响应单个可屏蔽中断的条件是（）。

  A . CPU开中断 B . 外设有中断请求信号 C . 外设中断请求信号不屏蔽 D . 同时满足上述A，B，C条件，且正在执行的指令执行完毕。

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• 可屏蔽中断INTR在中断请求时，CPU无响应则最可能的原因是什么？

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• 只有在CPU完成（）后，才能响应可屏蔽中断INTR请求。

  A . 当前时钟周期 B . 当前总线周期 C . 当前指令周期 D . 当前操作周期

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• 8088/8086在响应可屏蔽中断请求时（）。

  A . INTA输出一个负脉冲，将中断类型码从AD0～AD7读入 B . INTA输出两个负脉冲，在第二个负脉冲时读取中断类型码 C . INTA输出一个负脉冲后，进行一次I/O读周期，读取中断类型码 D . INTA输出一个负脉冲，同时提供I/O读控制信号，读中断类型码

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• 外部设备向8086/8088CPU申请可屏蔽中断时，中断请求信号是通过其（）引脚进入CPU的。

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• CPU响应（）中断时，不会由CPU自动清除中断请求标志。

  A . 外部中断0 B . 外部中断1 C . 串行口中断 D . 定时器/计数器溢出中断

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• CPU每次可以响应（）个中断源的中断请求。

  A、1 B、2 C、3 D、4

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• 可屏蔽中断的屏蔽通常可由CPU内部的（）来控制。

  A . 中断请求触发器 B . 中断屏蔽寄存器 C . 中断允许触发器 D . 中断锁存器

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• CPU正在处理一个低优先级中断时，若有一个高优先级中断请求发生，CPU会暂停当前中断处理，优先响应难先级中断请求。

  A . 正确 B . 错误

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• 必须有中断源发出中断请求，并且CPU开中断，CPU才可能响应中断。（）

  A . 正确 B . 错误

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• CPU响应INTR可屏蔽中断的条件是什么？

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• 在80x86中可屏蔽中断请求被CPU响应的条件是（）。

  A . INTR引脚有中断请求，NMI引脚没有中断请求，系统没有DMA请求 B . CPU当前指令执行完毕 C . 中断允许标志IF=1 D . 以上条件都包括

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• 如果希望一个中断源的中断请求能被CPU响应，需要满足两个条件：一是中断被设置为允许中断，而是中断优先级满足。

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• 微机系统中若用2片8259A构成主、从两级中断控制逻辑，接至CPU的可屏蔽中断请求线INTR上，最多可扩展为( )级外部硬中断。

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• 采用 8 片 8259A 可编程中断控制器级联使用，可以使 CPU 的可屏蔽中断扩大到 ( ) 个中断源

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• 可屏蔽中断请求可以被CPU用指令（）来禁止，也可由指令（）来允许。

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• 10、6．在开中断的前提下，只要中断源发出中断请求，CPU就会立刻响应中断。

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• CPU响应中断请求信号线INTR来的中断的条件是什么？ CPU如何响应中断？

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• Intel8086PC机中,多个可屏蔽的中断源是否响应（)。

  A．只受IF寄存器的影响 B．只受TF寄存器的影响 C．除受IF寄存器的影响外,还要受到8259A中断屏蔽寄存器的影响 D．除受TF寄存器的影响外,还要受到8259A中断屏蔽寄存器的影响

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• 10、在开中断的前提下，只要中断源发出中断请求，CPU就会立刻响应中断。

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• 多个中断源同时向CPU提出中断请求时，CPU将优先响应中断优先权高的中断请求（）

  是 否

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