试根据F007运算放大器的电路说明为什么“2”端是反相输入端;“3”端是同相输入端。

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• F007运算放大器的正、负电源电压为±15V，开环电压放大倍数Auo＝2³105，输出最大电压（即±UO（sat））为±13V。今在图中分别加下列输入电压，求输出电压及其极性：

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  <img src='https://img2.soutiyun.com/ask/2020-11-15/974324820322645.png' />

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• 电路如图4.14所示，试写出uo与ui的运算关系。

  电路如图4.14所示，试写出u_o与u_i的运算关系。 <img src='https://img2.soutiyun.com/ask/5448001-5451000/9dbb3ab87d6f5d77f4e73f5d55268fc5.gif' />

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• 555定时器芯片接成的电路如图6-26（a)所示。试回答: （1)该电路的名称是什么？ （2)若+V_OC=+1

  555定时器芯片接成的电路如图6-26(a)所示。试回答: (1)该电路的名称是什么？ (2)若+V_OC=+10V,R=10kΩ,C=300pF,计算其暂态脉冲宽度tPO. (3)给定输入u1的波形如图6-26(b)所示，已知低电平时长为10μs,试画出电容电压u_C的波形和对应的输出u_O的波形。注意此时输入u₁的低电平时长大于其暂态脉冲宽度。 (4)如果在图6-26(a)所示的555定时器芯片的5脚外接一个+5V的电压源，问暂 态脉冲宽度是增加、减少还是不变？为什么？ <img src='https://img2.soutiyun.com/ask/2020-09-06/968244942565249.png' />

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  图2.17(a)所示的为TTIL门电路,图2.17(b)所示的为CMOS门电路,试根据图2.17(c)中给出的输入A、B的波形画出Y₁、Y₂的波形. <img src='https://img2.soutiyun.com/ask/2021-01-21/980091383808201.png' />

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• 若题2-1-2图所示电路中电沉源的电流减小一半（即为2A),试根据线性电路的齐次性和可加性求电压U.

  若题2-1-2图所示电路中电沉源的电流减小一半(即为2A),试根据线性电路的齐次性和可加性求电压U. <img src='https://img2.soutiyun.com/ask/2020-10-09/971097219114177.jpg' />

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  电路如图题3.1 (a)、(b)、(c)、 (d)所示，试找出电路中的错误，并说明为什么。 <img src='https://img2.soutiyun.com/ask/2020-08-20/966789672813497.png' />

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• 设A={1,2.3} ,试根据所给定的运算表1-1和表1-2分别讨论其幂等性，交换性以及是否有单位元素,若有,请指出A中各元素的逆元素。

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• 1、实验任务 （1）完成四位并行进位电路的设计 （2）完成16位带溢出检测的并行加减运算器电路设计 （3）完成32位带溢出检测的并行加减运算器电路设计 2、要求：完成实验报告的撰写，内容包括： （1）实验目的：说明实验学习要达到的目标 （2）实验原理：阐述所设计电路的基本理论依据； （3）实验内容：阐述基本的实验环境条件，明确电路设计设计步骤，插入设计的电路导出图；进行电路延迟测试，阐述延迟测试方法，进行延迟测试结果分析； （4）实验中遇到的问题、建议及体会 3、提交材料，包括实验报告、设计电路工程文件 实验报告模板请下载。请认真思考，多位加减运算器有不同的设计方法，延迟有所不同。 三个电路每个30分，有多种设计方法的10分，根据内容完整性等酌情减分。

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