时序逻辑电路如图所示，原状态为“00”，当送入两个 C 脉冲后的新状态为（ ）。c470786ab075f59b1224c887685c866e.png

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  A . 11 B . 10 C . 01 D . 保持00不变

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  A . 00 B . 01 C . 11 D . 10

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• 时序逻辑电路的置数端有效，则电路为（）状态。

  A . A.计数 B . B.并行置数 C . C.置1 D . D.清0

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• （2008）如图所示电路中，Q1、Q2的原始状态为"11"当送入两个脉冲后的新状态为：（）https://assets.asklib.com/psource/201511041435343628.png

  A . "00" B . "01" C . "11" D . "10"

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  A . 11 B . 10 C . 01 D . 保持00不变

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• 触发器是组成时序逻辑电路中存储部分的基本单元，它有两个状态，分别称为（）。

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• 时序逻辑电路的输出，与电路的原状态（）.

  A . 有关 B . 无关 C . 不一定

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• 时序逻辑电路的清零端有效，则电路为（）状态。

  A . A.计数 B . B.保持 C . C.置1 D . D.清0

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• （）是组成时序逻辑电路中存储部分的基本单元，它有两个状态，分别称为（）和（）。

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• D触发器组成的同步时序逻辑电路如题36图所示，该时序电路为（）。https://assets.asklib.com/psource/201511020929423104.jpg

  A . 四进制减法计算器 B . 四进制加法计算器 C . 三进制减法计算器 D . 三进制加法计算器

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• 如图所示电路，设Q1、Q0的原状态为00，送入一个CP脉冲后的新状态为（）。https://assets.asklib.com/psource/2015110110345310190.jpg

  A . 11 B . 10 C . 01 D . 00

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  A . ①②③④ B . ①③④② C . ②③④① D . ①②④③

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• D触发器组成的异步时序逻辑电路如题36图所示，该时序电路为（）。https://assets.asklib.com/psource/2015110210021760004.jpg

  A . 四进制减法计算器 B . 四进制加法计算器 C . 八进制减法计算器 D . 八进制加法计算器

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  A .https://assets.asklib.com/images/image2/2017062617011282232.jpg B .https://assets.asklib.com/images/image2/2017062617010750145.jpg C .https://assets.asklib.com/images/image2/2017062617005814932.jpg

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  TTL逻辑电路组成的同步时序电路如图11-66所示。(1)试分析图中虚线框内电路，画出Q1、Q2、Q3波形，并说明虚线框内电路的逻辑功能。(2)若把电路中的Z输出和各触发器的置零端CR连接在一起，试说叨当X1X2X3为110时，整个电路的逻辑功能是什么？ <img src='https://img2.soutiyun.com/ask/2020-07-22/964284879679792.png' />

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  <img src='https://img2.soutiyun.com/shangxueba/ask/17865001-17868000/17866529/2015110210021760004.jpg' /> A．四进制减法计算器 B． 四进制加法计算器 C． 八进制减法计算器 D． 八进制加法计算器

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  <img src='https://img2.soutiyun.com/ask/2020-09-06/968245330599443.png' />

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  <img src='https://img2.soutiyun.com/ask/2020-12-25/977735000278167.png' />

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  <img src='https://img2.soutiyun.com/ask/2020-08-21/966890091088365.png' />

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