设计一个组合逻辑电路，输入为2比特位宽的二进制数（设高位为x，低位为y），当这个二进制数大于或等于1时，电路输出F为1，否则输出为0。列出该电路的真值表，并写出输出信号的逻辑表达式。

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• 一个二进制序列检测电路，当输入序列中连续输入5位数码均为1时，电路输出1，则同步时序电路最简状态数为（）。

  A . 4 B . 5 C . 6 D . 7

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• 把文字、符合转换为二进制码的组合逻辑电路是（）

  A . 编码器 B . 译码器 C . 数据选择器 D . 数据分配器

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• 对一个具有符号集B=（b1，b2）={0，1}的二元信源，设信源产生2个符号的概率分别为P（b1）=1/5和P（b2）=4/5，如对二进制数1001进行算术编码，其结果用十进制数表示为（）。

  A . A.0.26 B . B.0.24 C . C.0.22 D . D.0.20

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• 对于组合逻辑电路而言（） ①从逻辑功能上看，它的输出仅决定于该时刻输入； ②从电路结构上看，不包括存贮信息单元； ③它的逻辑功能用一个方程即可以描述； ④它的逻辑功能可以用真值表描述：

  A . A、以上结论均不正确 B . B、以上结论均正确 C . C、仅有一个正确 D . D、有两个结论正确

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• 一个三位二进制数码由高位至低位分别送至电路的三个输入端，要求三位数码中有奇数个1时，电路输出为1，否则为0。试画出逻辑图。

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• 二进制译码器相当于是一个最小项发生器,便于实现组合逻辑电路。

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• 从组合逻辑角度看，二进制译码器相当于是一个最小项发生器，便于实现组合逻辑电路。（ ）

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• 下列叙述正确的有？ 1. 数字逻辑电路分为组合逻辑电路和时序逻辑电路； 2. 时序逻辑电路是组合逻辑电路的基础； 3. 逻辑电路的文档标准是理解数字电路规范化的技术“语言”； 4. 组合逻辑电路的输出信号与它过去的输入序列有关。

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• 4位二进制加权型DAC电路，设基准电压VREF=-8V，2RF=R，试求输入二进制数1101时输出的电压值，以及LSB，MSB和FSR

  4位二进制加权型DAC电路，设基准电压V_REF=-8V，2R_F=R，试求输入二进制数1101时输出的电压值，以及LSB，MSB和FSR值。

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• 11、二进制译码器相当于是一个最小项发生器，便于实现组合逻辑电路。

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• 利用集成二进制计数器CT74163和必要的门电路,设计一个分频器.当输入X为1Hz方波时,输出Y为60Hz方波(占空比为1).要求采用模10计数器和模6计数器串联设计.画出整个电路的逻辑电路连接图,并做出每一个CT74163器件的状态转移图.CT74163的逻辑符号如图10.106所示.

  <img src='https://img2.soutiyun.com/ask/2021-02-25/983110570560111.png' />

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  A．A B C D Y 0 0 0 0 0 0 0 0 1 0 0 0 1 0 0 0 0 1 1 0 0 1 0 0 0 0 1 0 1 1 0 1 1 0 1 0 1 1 1 1 1 0 0 0 1 1 0 0 1 1 B．A B C D Y 0 0 0 0 1 0 0 0 1 1 0 0 1 0 1 0 0 1 1 1 0 1 0 0 1 0 1 0 1 0 0 1 1 0 0 0 1 1 1 0 1 0 0 0 0 1 0 0 1 0 C．A B C D Y 0 0 0 0 1 0 0 0 1 1 0 0 1 0 1 0 0 1 1 0 0 1 0 0 1 0 1 0 1 0 0 1 1 0 0 0 1 1 1 0 1 0 0 0 0 1 0 0 1 0 D．A B C D Y 0 0 0 0 1 0 0 0 1 1 0 0 1 0 1 0 0 1 1 1 0 1 0 0 1 0 1 0 1 1 0 1 1 0 1 0 1 1 1

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  <img src='https://img2.soutiyun.com/ask/2021-01-31/980936844000108.png' />

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• 用同步十六进制计数器74163设计一个可变进制计数器，要求在控制信号M=0时为十进制，而在M=1时为十二进制。可以附加必要的门电路。请标明计数输入端与进位输出端。

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• 设计一个补码发生器电路。当输入为负数时，控制信号M=1，输出Y₃Y₂Y₁Y₀是输入二进制数DCBA的补码;而当输入为正数时，控制信号M=0，输出与输入相同，即Y₃Y₂Y₁Y₀=DCBA.请选用适当的中规模集成电路实现。可以附加必要的门电路，但电路应尽量简单。

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