试用JK触发器设计一个可控计数器，当控制信号M=0时工作在五进制，当M=1时工作在六进制。
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JK触发电路中，当J=K=0、Qn=1时，触发器的状态（）。
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JK触发电路中，当J=0、K=1、Q=0时，触发器的状态（）
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JK触发电路中，当J=0、K=1、Qn=1时，触发器的状态（）。
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JK触发电路中，当J=K=Qn=0时，触发器的状态（）。
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JK触发器当J值为1，K值为0时，触发器（）。
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用同步十六进制计数器74HC161设计一个可变进制的计数器。要求在控制信号M=0时，为十二进制，在M=1时为十进制。请标明计数输入端和进位输出端。74HC161的框图和功能表见图T2.6和表T2.6。
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试用JK触发器设计一个三相六拍脉冲分配器.分配器的输出波形如图5-56所示.
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试用JK触发器设计一个同步七进制计数器，当计满时输出一个0.
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设计一个可变进制的同步计数器。它有一个控制端M：当M为0时，实现7进制计数器；M为1时，实现5进制计数器。请用D触发器和门路电路(门电路类型不限)实现，画出最简逻辑图，并验证能否自启动(若不能自启动，不必修改成自启动电路)。
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图7．3．30所示电路是由MSI二进制优先编码器74148和计数器74160组成的可控分频器。试分析当输入控制信号A0～A7分别为低电平时电路的分频比。
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K触发器，当JK为__时，触发器处于置0状态（）
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填空题2.Jk触发器具有最强的逻辑功能，在外部J、K信号的控制下，它能执行保持、置0、置1和（）操作。
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2、用JK触发器设计一个五进制同步计数器，Q2Q1Q0状态转换关系参见附件。 要有设计过程，提供状态表、状态分配、激励函数和输出函数、自启动和逻辑图。
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用触发器和门电路设计一个同步七进制计数器，下面说法正确的是： A: 只能选用JK触发器 B: 选用JK触发器、D触发器都可以 C: 必须选用3个触发器 D: 必须选用4个触发器 E: 选用2个触发器就可以了 F: 所有的触发器必须用同一个时钟信号驱动 G: 只需要低位的触发器用时钟信号驱动
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试用4个负边沿触发的JK触发器构成一个异步二进制加法计数器，要求画出逻辑图和输出波形。
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若要实现一个可暂停的一位二进制计数器，控制信号A=0计数，A=1保持，可选用T触发器，且令T=A。
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试用4个具有复位功能的D触发器设计一个扭环行为器用复位方式将计数器，初始状态置为Q<sub>3</sub>Q<sub>2</sub>Q<sub>1</sub>Q<sub>0</sub>=0000，并用8个二输入端与门对它的8个计数状态译码，画出电路图。
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用JK触发器和门电路设计一个4位格雷码计数器,它的状态转换表如表P6.32所示.
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1、试用JK触发器完成“111”序列检测器的设计。要有设计过程，提供状态化简、状态分配、激励函数和输出函数、自启动和逻辑图。
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试用T触发器（将JK触发器的J、K端连接在一起)设计一个模5可逆计数器。
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用同步十六进制计数器74163设计一个可变进制计数器，要求在控制信号M=0时为十进制，而在M=1时为十二进制。可以附加必要的门电路。请标明计数输入端与进位输出端。
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设计一个补码发生器电路。当输入为负数时，控制信号M=1，输出Y<sub>3</sub>Y<sub>2</sub>Y<sub>1</sub>Y<sub>0</sub>是输入二进制数DCBA的补码;而当输入为正数时，控制信号M=0，输出与输入相同，即Y<sub>3</sub>Y<sub>2</sub>Y<sub>1</sub>Y<sub>0</sub>=DCBA.请选用适当的中规模集成电路实现。可以附加必要的门电路，但电路应尽量简单。
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三个JK触发器可以构成一个五进制计数器。
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1、1. 对于边沿JK触发器，当J=0，K=0时，触发器的次态为（)
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