D触发器在CP端脉冲作用后，其输出Qn+1=D。
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D触发器的应用电路如图所示，设输出Q的初值为0，那么，在时钟脉冲cp的作用下，输出Q为（）。https://assets.asklib.com/psource/2016071816385988550.jpg
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已知逻辑电路如图所示，当X=0时，脉冲CP到来后，D触发器（）。https://assets.asklib.com/psource/2015110110405837679.jpg
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（2010）D触发器的应用电路如图所示，设输出Q的初值为0，那么，在时钟脉冲CP的作用下，输出Q为：（）https://assets.asklib.com/psource/2015110414275677522.png
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由D触发器转换成的T触发器其输出状态是在CP脉冲的（）时变化。
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无论J－K触发器原来状态如何，当输入端J＝1、K＝0时，在时钟脉冲作用下，其输出端Q的状态为（）。
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D触发器在D=1时，输入一个CP脉冲，其逻辑功能是（）。
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已知JK触发器工作时，J≠K，则在CP上的脉冲作用后，触发器输出Q的状态为（）
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如果把D触发器的输出Q反馈连接到输入D，则输出Q的脉冲波形的频率为CP脉冲频率f的（）。
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在CP有效的情况下，当输入端D=0时，则D触发器的输出端Qn+1=（）
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23、下降沿触发的D触发器，其输出（Q的非）与输入D连接，触发器初始状态为0，在CP脉冲作用下，输出Q的波形为下图中的波形（ ）。A (A) B (B) C (C)41d409de6404406bcc02c7dda56dd8ff.png
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27、在下图中，触发器的初态Q1Q0＝01，则在第一个CP脉冲作用后，输出Q1Q0为（）。A 00 B 01 C 10 D 1170c3438bccfa7783b2ec0913c6838fab.png
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同步D触发器在CP=1期间，当D端输入信号变化时，对输出Q端没有影响。（ ）
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对于D触发器，欲使Qn+1=Qn，应使输入D=（ ）。
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JK触发器的输入J=K=1，当CP脉冲输入频率为50kHz的方波时，Q端输出脉冲的频率为（ ）。
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在 CP 脉冲作用下,只具有置 0 、置 1 和保持功能的触发器是（）触发器。 A . JK 触发器 B . T 触发器 C . T / 触发器 D . RS 触发器A．A
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D触发器的应用电路如图所示，设输出Q的初值为0，那么，在时钟脉冲CP的作用下， 输出Q为：<img src='https://img2.soutiyun.com/ask/uploadfile/3987001-3990000/35a5adee85ba297e1eed343fedaa23b7.jpg' />
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D触发器的输入D＝1，在时钟脉冲作用下，输出端Q（）。
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2、数字去抖动电路中，当信号被串入电路后，能在输出端输出脉冲信号的条件是，必须在4个D触发器的输出端Q同时为（），最终才能输出高电平。
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在 CP 脉冲作用下,只具有置 0 、置 1 和保持功能的触发器是（）触发器。 A . JK 触发器 B . T 触发器 C . T / 触发器 D . RS 触发器
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36、边沿JK触发器在输入J=K=1时，如果CP信号的频率为32 kHz，则Q端输出脉冲的频率为16 kHz。
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4、当D=0时，在时钟脉冲CP的上升沿到来时，使触发器的状态变为0
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上升沿触发的边沿D触发器在输入D=1时,输入时钟脉冲CP上升沿后,触发器翻到1状态（）
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2、对于D触发器，输入D=1，CP脉冲作用后，触发器的次态应为 （)。 A. 0 B. 1 C. 0或1 D.不确定
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当D=0时，在时钟脉冲CP的上升沿到来时，使触发器的状态变为0.
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